/************************************************************************/ /* File Version : V0.5B */ /* History : 0.5B (2015-11-20) [Hardware Manual Revision : 0.5B] */ /* Date Modified: 26/04/2016 */ /************************************************************************/ #ifndef INTERRUPT_HANDLERS_H #define INTERRUPT_HANDLERS_H // Exception(Supervisor Instruction) #pragma interrupt (Excep_SuperVisorInst) void INT_Excep_SuperVisorInst(void) __attribute__ ((interrupt)); // Exception(Access Instruction) #pragma interrupt (Excep_AccessInst) void INT_Excep_AccessInst(void) __attribute__ ((interrupt)); // Exception(Undefined Instruction) #pragma interrupt (Excep_UndefinedInst) void INT_Excep_UndefinedInst(void) __attribute__ ((interrupt)); // Exception(Floating Point) #pragma interrupt (Excep_FloatingPoint) void INT_Excep_FloatingPoint(void) __attribute__ ((interrupt)); // NMI #pragma interrupt (NonMaskableInterrupt) void INT_NonMaskableInterrupt(void) __attribute__ ((interrupt)); // Dummy #pragma interrupt (Dummy) void Dummy(void) __attribute__ ((interrupt)); // BRK #pragma interrupt (Excep_BRK(vect=0)) void INT_Excep_BRK(void) __attribute__ ((interrupt)); // vector 1 reserved // vector 2 reserved // vector 3 reserved // vector 4 reserved // vector 5 reserved // vector 6 reserved // vector 7 reserved // vector 8 reserved // vector 9 reserved // vector 10 reserved // vector 11 reserved // vector 12 reserved // vector 13 reserved // vector 14 reserved // vector 15 reserved // BSC BUSERR #pragma interrupt (Excep_BSC_BUSERR(vect=16)) void INT_Excep_BSC_BUSERR(void) __attribute__ ((interrupt)); // vector 17 reserved // RAM RAMERR #pragma interrupt (Excep_RAM_RAMERR(vect=18)) void INT_Excep_RAM_RAMERR(void) __attribute__ ((interrupt)); // vector 19 reserved // vector 20 reserved // FCU FIFERR #pragma interrupt (Excep_FCU_FIFERR(vect=21)) void INT_Excep_FCU_FIFERR(void) __attribute__ ((interrupt)); // vector 22 reserved // FCU FRDYI #pragma interrupt (Excep_FCU_FRDYI(vect=23)) void INT_Excep_FCU_FRDYI(void) __attribute__ ((interrupt)); // vector 24 reserved // vector 25 reserved // ICU SWINT2 #pragma interrupt (Excep_ICU_SWINT2(vect=26)) void INT_Excep_ICU_SWINT2(void) __attribute__ ((interrupt)); // ICU SWINT #pragma interrupt (Excep_ICU_SWINT(vect=27)) void INT_Excep_ICU_SWINT(void) __attribute__ ((interrupt)); // CMT0 CMI0 #pragma interrupt (Excep_CMT0_CMI0(vect=28)) void INT_Excep_CMT0_CMI0(void) __attribute__ ((interrupt)); // CMT1 CMI1 #pragma interrupt (Excep_CMT1_CMI1(vect=29)) void INT_Excep_CMT1_CMI1(void) __attribute__ ((interrupt)); // CMTW0 CMWI0 #pragma interrupt (Excep_CMTW0_CMWI0(vect=30)) void INT_Excep_CMTW0_CMWI0(void) __attribute__ ((interrupt)); // CMTW1 CMWI1 #pragma interrupt (Excep_CMTW1_CMWI1(vect=31)) void INT_Excep_CMTW1_CMWI1(void) __attribute__ ((interrupt)); // vector 32 reserved // vector 33 reserved // USB0 D0FIFO0 #pragma interrupt (Excep_USB0_D0FIFO0(vect=34)) void INT_Excep_USB0_D0FIFO0(void) __attribute__ ((interrupt)); // USB0 D1FIFO0 #pragma interrupt (Excep_USB0_D1FIFO0(vect=35)) void INT_Excep_USB0_D1FIFO0(void) __attribute__ ((interrupt)); // vector 36 reserved // vector 37 reserved // RSPI0 SPRI0 #pragma interrupt (Excep_RSPI0_SPRI0(vect=38)) void INT_Excep_RSPI0_SPRI0(void) __attribute__ ((interrupt)); // RSPI0 SPTI0 #pragma interrupt (Excep_RSPI0_SPTI0(vect=39)) void INT_Excep_RSPI0_SPTI0(void) __attribute__ ((interrupt)); // RSPI1 SPRI1 #pragma interrupt (Excep_RSPI1_SPRI1(vect=40)) void INT_Excep_RSPI1_SPRI1(void) __attribute__ ((interrupt)); // RSPI1 SPTI1 #pragma interrupt (Excep_RSPI1_SPTI1(vect=41)) void INT_Excep_RSPI1_SPTI1(void) __attribute__ ((interrupt)); // QSPI SPRI #pragma interrupt (Excep_QSPI_SPRI(vect=42)) void INT_Excep_QSPI_SPRI(void) __attribute__ ((interrupt)); // QSPI SPTI #pragma interrupt (Excep_QSPI_SPTI(vect=43)) void INT_Excep_QSPI_SPTI(void) __attribute__ ((interrupt)); // SDHI SBFAI #pragma interrupt (Excep_SDHI_SBFAI(vect=44)) void INT_Excep_SDHI_SBFAI(void) __attribute__ ((interrupt)); // MMCIF MBFAI #pragma interrupt (Excep_MMCIF_MBFAI(vect=45)) void INT_Excep_MMCIF_MBFAI(void) __attribute__ ((interrupt)); // vector 46 reserved // vector 47 reserved // vector 48 reserved // vector 49 reserved // vector 50 reserved // vector 51 reserved // RIIC0 RXI0 #pragma interrupt (Excep_RIIC0_RXI0(vect=52)) void INT_Excep_RIIC0_RXI0(void) __attribute__ ((interrupt)); // RIIC0 TXI0 #pragma interrupt (Excep_RIIC0_TXI0(vect=53)) void INT_Excep_RIIC0_TXI0(void) __attribute__ ((interrupt)); // RIIC2 RXI2 #pragma interrupt (Excep_RIIC2_RXI2(vect=54)) void INT_Excep_RIIC2_RXI2(void) __attribute__ ((interrupt)); // RIIC2 TXI2 #pragma interrupt (Excep_RIIC2_TXI2(vect=55)) void INT_Excep_RIIC2_TXI2(void) __attribute__ ((interrupt)); // vector 56 reserved // vector 57 reserved // SCI0 RXI0 #pragma interrupt (Excep_SCI0_RXI0(vect=58)) void INT_Excep_SCI0_RXI0(void) __attribute__ ((interrupt)); // SCI0 TXI0 #pragma interrupt (Excep_SCI0_TXI0(vect=59)) void INT_Excep_SCI0_TXI0(void) __attribute__ ((interrupt)); // SCI1 RXI1 #pragma interrupt (Excep_SCI1_RXI1(vect=60)) void INT_Excep_SCI1_RXI1(void) __attribute__ ((interrupt)); // SCI1 TXI1 #pragma interrupt (Excep_SCI1_TXI1(vect=61)) void INT_Excep_SCI1_TXI1(void) __attribute__ ((interrupt)); // SCI2 RXI2 #pragma interrupt (Excep_SCI2_RXI2(vect=62)) void INT_Excep_SCI2_RXI2(void) __attribute__ ((interrupt)); // SCI2 TXI2 #pragma interrupt (Excep_SCI2_TXI2(vect=63)) void INT_Excep_SCI2_TXI2(void) __attribute__ ((interrupt)); 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